实验十二：Cache设计 （选做）
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实验十二：Cache设计 （选做）
主要内容：利用Verilog HDL对Cache建模与验证。
实验类型：设计性实验。
陈付龙，孙道清，沈展，徐晟，罗乐，陈士县，周武
目录
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1 前言
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1.1 课程简介
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1.2 说课
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1.3 预备学习
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2 计算机系统概论
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2.1 计算机的发展历程
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2.2 计算机系统的基本组成
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2.3 计算机系统的层次结构
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2.4 程序开发与执行过程
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2.5 计算机系统性能评价
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2.6 本章小结
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3 数据的机器级表示
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3.1 数制和编码
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3.2 定点数的表示
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3.3 浮点数的表示
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3.4 十进制数的表示
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3.5 非数值数据的编码表示
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3.6 数据的宽度和存储
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3.7 数据的校验码
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3.8 本章小结
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4 运算方法和运算部件
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4.1 高级语言和机器指令中的运算
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4.2 基本运算部件
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4.3 定点数运算
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4.4 浮点数运算
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4.5 运算部件的组成
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5 存储器分层体系结构
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5.1 存储器概述和RAM芯片
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5.2 主存与CPU的连接及其读写操作
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5.3 高速缓冲存储器
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5.4 虚拟存储器
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5.5 本章小结
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6 指令系统
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6.1 指令格式设计
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6.2 指令系统设计
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6.3 指令系统实例
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6.4 程序的指令集表示
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6.5 本章小结
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7 中央处理器
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7.1 CPU概述
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7.2 单周期处理器设计
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7.3 多周期处理器设计
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7.4 微程序控制器设计
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7.5 异常和中断处理
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7.6 本章小结
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8 指令流水线
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8.1 指令流水线概述
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8.2 流水线数据通路和控制逻辑
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8.3 流水线冒险及其处理
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8.4 高级流水线技术
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8.5 本章小结
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9 互连及输入 输出组织
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9.1 外设概述
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9.2 外设与CPU、主存的互连
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9.3 I/O接口
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9.4 I/O数据传送方式
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9.5 I/O子系统
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9.6 本章小结
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10 复习
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10.1 知识要点
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10.2 2013年试卷
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10.3 2014年试卷
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10.4 2015年试卷
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10.5 2016年试卷
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10.6 2017年试卷
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10.7 2018年试卷
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10.8 2019年试卷
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10.9 2020年考试
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10.10 2021年试卷
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10.11 2022年试卷
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10.12 2023年试卷
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10.13 2024年试卷
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11 实验
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11.1 实验一：Xilinx Nexys4开发板使用（选做）
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11.2 实验二：数据的机器级表示
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11.3 实验三：定点加减法实现
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11.4 实验四：定点乘除法实现（选做）
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11.5 实验五：逻辑运算与移位运算（选做）
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11.6 实验六：ALU设计
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11.7 实验七：浮点加减法（选做）
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11.8 实验八：浮点乘法和除法（选做）
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11.9 实验九：浮点运算单元（选做）
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11.10 实验十：寄存器设计
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11.11 实验十一：RAM和ROM设计
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11.12 实验十二：Cache设计 （选做）
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11.13 实验十三：MIPS汇编程序调试
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11.14 实验十四：单周期MIPS微处理器设计
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11.15 实验十五：简单多周期MIPS微处理器设计（选做）
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11.16 实验十六：复杂多周期MIPS微处理器设计（选做）
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11.17 实验十七：流水线MIPS微处理器设计（选做）
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