职称:教师
单位:安徽师范大学
部门:计算机与信息学院
主讲教师:齐学梅,陈付龙,孙道清,沈展,刘永斌,徐晟
教师团队:共13位
| 学校: | 安徽师范大学 |
| 开课院系: | 计算机与信息学院 |
| 开课专业: | 计算机类 |
| 学分: | 1 |
| 课时: | 34 |
《计算机组成原理实验》课程以数字逻辑实验课程为基础,是计算机组成原理课程的配套实验课程。主要学习计算机基本组成、各大组成部件的结构和工作原理、指令执行过程等,课程注重基础知识与新技术的融合。通过本课程学习,培养学生分析和解决实际问题的能力,学生将学习计算机组成原理实验基本原理和方法,使用Verilog HDL、Xilinx Vivido等EDA工具软件、Xilinx Artix FPGA,形成基本的实验设计与操作技能(如运算器设计、控制器设计等,并进行仿真和测试等),训练计算机各组成部件及计算机硬件系统的设计、仿真、分析、综合、下载、测试等环节操作的方法,验证计算机组成原理课程的基本概念、基本结构、基本工作原理,对组成计算机的各个部件的功能和工作过程、以及部件间的连接,有较全面、较系统地认识,形成较完整的计算机组成与工作原理模型。
| 课程章节 | | 文件类型 | | 修改时间 | | 大小 | | 备注 | |
| 1.1 电子设计自动化概述 |
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2021-08-15 | 472.38KB | ||
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2021-08-15 | 959.68KB | |||
| 1.2 Xilinx Nexys 4 FPGA 开发板 |
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| 1.3 Xilinx Vivado |
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| 1.4 工程示例 |
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2021-08-15 | 2.78MB | |||
| 1.5 实验 |
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2021-09-07 | 34.35KB | ||
| 2.1 Verilog HDL简介 |
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2021-08-15 | 778.47KB | ||
| 2.2 Verilog HDL层次建模 |
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2021-08-15 | 583.42KB | |||
| 2.3 Verilog HDL结构化建模 |
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| 2.4 Verilog HDL数据流建模 |
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2021-08-15 | 635.20KB | ||
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2021-08-15 | 907.00KB | |||
| 2.5 Verilog HDL行为建模 |
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| 2.6 实验 |
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| 3.1 编码转换 |
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| 3.2 定点数和浮点数 |
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| 3.3 数据的宽度和存储 |
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| 3.4 数据校验码 |
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| 3.5 实验 |
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| 4.1 加法器 |
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| 4.2 定点加/减法 |
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| 4.3 定点乘法 |
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| 4.4 定点除法 |
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| 4.5 逻辑运算与移位运算 |
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| 4.6 算术逻辑单元(ALU) |
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| 4.7 实验 |
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| 5.1 浮点加减法 |
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| 5.2 浮点乘法 |
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| 5.3 浮点除法 |
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| 5.4 浮点运算单元 |
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| 6.1 寄存器 |
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| 6.2 半导体存储器 |
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| 6.3 半导体存储器容量的扩展 |
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| 6.4 实验 |
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| 7.1 Cache原理 |
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| 7.2 直接映像方式 |
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| 7.3 全相联映像方式 |
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| 7.4 组相联映像方式 |
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| 7.5 替换策略 |
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| 7.6 写策略(一致性问题) |
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| 8.1 MIPS处理器架构 |
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| 8.2 MIPS-C指令集 |
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| 8.3 MIPS汇编程序设计 |
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| 8.4 MIPS汇编程序编辑和调试 |
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| 8.5 实验 |
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| 9.1 CPU设计概述 |
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2022-11-24 | 313.98KB | ||
| 9.2 单周期MIPS处理器的数据通路设计 |
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| 9.3 单周期MIPS处理器的控制器设计 |
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| 9.4 单周期MIPS处理器的仿真与测试 |
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| 10.1 多周期MIPS处理器的数据通路设计 |
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| 10.2 多周期MIPS处理器的控制器设计 |
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| 11.1 理想流水线 |
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| 11.2 气泡流水线 |
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| 11.3 转发流水线 |
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